德州仪器新型低相位噪声时钟合成器可极大降低成本并缩减能节省70的板级空间

日前，德州仪器公司 (TI) 宣布推出一款新型低相位噪声时钟合成器，其具有的倍频、分频及抖动清除等功能可为板级设计者优化定时性能，从而使板级空间缩小了 70%。这种新型的集成芯片不仅降低了板级成本，而且还减少大量分立组件的数量。（如欲了解更多有关详细信息，敬请访问 ）

CDC7005完成压控制晶体振荡器 (VCXO) 与参考时钟同步，并集成低噪相位/频率检测器、高精度充电泵、可编程除法器、运算放大器以及具有除法选项的 1:5 差分时钟缓冲器。该器件的低相位噪声性能非常有益于包括 A/D-D/A 转换器、串/并转换器、ASIC 及要求高精度参考定时的数字信号处理器 (DSP) 等在内的众多众多信号链路器件，是通信、仪表以及工业应用领域的理想选择。

CDC7005 可接受 3.5 MHz 到 180 MHz 的参考时钟，并要求 VCXO 时钟范围介于 10 MHz～800 MHz 之间以保持同步。通过选择适当的 VCXO、乘以或除以参考时钟，以及从单独可编程除法组合中进行选择，该器件可输出高达 180 MHz 的时钟频率。

CDC7005 可提供五路低扭曲(Skew)的差动输出，并可灵活地选择甚至低于 10 Hz 的最佳 PLL 环路带宽，从而能够从进入的参考时钟清除输入的参考时钟中的抖动。集成运算放大器可用于优化具有有源滤波器设计的环路带宽。此外，在在无需外部组件的情况下也的情况下可编程设置输出相位。

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